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[Nvidia] Nvidia IC design 面经

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发表于 2-6-2017 03:55 AM | 显示全部楼层 |阅读模式

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本帖最后由 Sophia 于 2-6-2017 02:25 PM 编辑 ' p& N" C' A4 C9 I+ m
% S1 R! j% X; X' c( N2 A) i1 G
面的是nvidia backend IC  design组。% |4 z( |, T- e! m+ Z. h5 @* N1 t
把重点问几个问题说一下:, y. \! m7 \; \5 ]
1. 什么是clock uncertainty,   什么导致的?, L( T/ g- \3 Y  f
2. back block implementation   怎么 fix   congestion
+ j+ R0 O/ I; O7 F3. 怎么fix timing violation ,怎么optimize timing?& \' u8 c4 Y! d+ D" D/ e
4. 什么是grey code, 电路中 grey code的作用
1 i  k: p; _& R# C" a5 b5. 问了  setup time 和  hold time 计算, 这也是必考内容了+ \% J1 |. Q" S' L& L
6. 让你讲一下backend design怎么 设计floorplan5 l5 M; l2 g. M, j* X
7. 让你分别用 perl  和 tcl  写程序, 让你把  timing  report里所有的 violated path  抓出来$ I7 e+ L3 W4 `) D4 q1 [8 T5 c
8。 问了一道算法题, 写 code, 怎么能快速计算出前100个素数。 (考我这个,可能是看我的背景有做cad, 写 script和做 automation。5 ?9 a5 r  H; z) Z
9,问了什么是 finfet,和 traditional的有什么区别

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发表于 2-6-2017 03:55 AM | 显示全部楼层
楼主sushu1122帖子好赞~~~
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发表于 2-8-2017 02:47 PM | 显示全部楼层
好帖~~~学习了~~~
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